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随着电子技术的飞速发展，单片机也步如一个新的时代，越来越多的功能各异的单片机为我们的设计提供了许多新的方法与思路。对于莫一些场合，比如：复杂的后台运算及通信与高实时性前台控制系统、软件资源消耗大的系统、功能强大的低消耗系统、加密系统等等。如果合理使用多种不同类型的单片机组合设计，可以得到极高灵活性与性能价格比，因此，多种异型单片机系统设计渐渐成为一种新的思路，但单片机之间的通信一直困扰种方法拓展的主要问题。本文将分析比较几种单片机之间的方式、难点，并提出一种解决方案。在近日举办的中国国际国防电子展上，国内知名固态硬盘厂商源科（runcore）展示了从到民用各个级别的多个系列ssd（固态硬盘）产品。源科从军工产品起家，得到国防科大的大力支持。因此，源科的所有技术均源自军工技术。
“大家都知道军工产品的可靠性和安全性较高，将这些特点带到消费和民用市场，则成为主要竞争力。所以可以说源科的设计团队和产品都带有一丝‘军工气质’”，源科公司总经理吴佳表示，大家知道，无论何种高新技术，一般都被首先用于军事和国家安全。在军事领域，其发展路线也可以总结为：航天-航空-舰船。终当民用市场出现较大需求时，该技术则转为民用，比较明显的例子除了固态存储，还有cdma等通讯技术。
军工和民用的定位不同；军工产品注重品质和稳定性，民用产品则更体现和应用。吴佳指出，除此之外，国际和国内市场的策略也略有不同。在国内，源科主要定位面向海外市场的中高端产品，跳出中国企业走低端低价路线的怪圈，定位于高品质的市场，以此赚取较高的附加值。他说，“固态存储大约20年前即被用于飞机上的数据存储，实际是非常成熟的技术，在消费等民用市场，ssd普及的主要推动因素除了价格，主要还有对传输速率的需求。现在的sata2已经不能满足消费者对存储速率的要求，而传统硬盘（hdd）又成为sata3的瓶颈，这就客观上成为ssd迅速发展的推动力”。
ftdi的vinculumvnc1l提供了一个低成本微控制器与usb2.0低/全速外设之间的接口，易于使用和编程，其指令集类似于dos命令，可在微控制器环境下很容易地编写调试数据以及传输例程，同时设计简单，使嵌入式系统能以较低成本实现usb主机功能。因此用户将可以采用低成本通用usb闪存盘作为系统存储媒介，而且还能在现场进行软件升级。此外vnc1l还可用于连接除了大
容量存储设备之外的很多其他usb外设，不过这部分内容在本文讨论范围之外。
vinculumic给usb接口增加不到10%的功耗，对系统而言更低，但能以非常容易及直接的方式为便携式设备增加usb2.0主机控制器端口。vdap固件以及介绍完整指令集的文件可从ftdi的vinculum网站下载。
在pic引脚2和3之间接入一个20mhz晶振可在其uart接口获得高达115200bit/s波特率，而使用内部8mhz振荡器只能获得高9600bit/s波特率，因此加接晶振可提高系统性能。pic的io引脚rc2和rc3都被固件使用，以模拟与vnc1luart连接的rts/cts握手信号。系统由pic上的固件控制，数据传输则由pic发出的指令控制，该指令由vinculum上的标准固件进行解释。虽然说起来很简单，但完成设计还有其他一些工作要做，例如器件还需要电源、控制时钟的晶振以及编程。 泰克实时示波器中的选件ddra（dpo的泰克实时示波器/dsa70000系列，mso70000系列，dpo7000系列）是一个软件工具，用于ddr设备测试设置和自动化测试。ddra提供的符合jedec规范的广大的测量设置，但对于非标准设备或系统工程，用户也可以选择自定义多个设置完成测量任务。目前此软件选件支持六种不同的ddr技术：ddr、ddr2、ddr3、lpddr、lpddr2和gddr3。
选件ddra连同泰克示波器上的另外两个软件：搜索&标记（选件asm，上面已描述）和dpojet抖动和眼图分析工具，这三个工具结合在一起使用，建立了一个强大、灵活且易使用的ddr测试和调试套件。
随着时钟速率和数据传输速率不断增加和性能的提高，设计工程师必须保证系统的性能指标，或确保系统内部存储器和存储器控制设备的互操作性，存储器子系统的模拟信号完整性已成为设计工程师越来越多重点考虑的问题。许多性能问题，甚至在协议层发现的问题，也可以追溯到信号完整性问题上。因此，存储器的模拟信号完整性验证已经成为很多电子设计验证关键的一步。
jedec(电子工程设计发展联合协会)已经明确规定存储设备详细测试要求，需要对抖动、定时和电气信号质量进行验证。测试参数：如时钟抖动、建立和保持时间、信号的过冲、信号的下冲、过渡电压等列入了jedec为存储器技术制定的测试规范。但执行规范里的这些测试是一个很大的挑战，因为进行这些测试很可能是一个复杂而又耗时的任务。拥有正确的工具和技术，可以减少测试时间，并确保准确的测试结果。在本应用文章中，我们将讨论针对存储器测试的解决方案，这个方案能够帮助工程师战胜挑战和简化验证过程。
几乎每一个电子设备，从智能手机到服务器，都使用了某种形式的ram存储器。尽管闪存nand继续流行(由于各式各样的消费电子产品的流行)，由于sdram为相对较低的每比特成本提供了速度和存储很好的结合，sdram仍然是大多数计算机以及基于计算机产品的主流存储器技术。ddr是双数据速率的sdram内存，已经成为今天存储器技术的选择。ddr技术不断发展，不断提高速度和容量，同时降低成本，减小功率和存储设备的物理尺寸。系统设置了一个全局链表 mempartion **partition_list 来存储所有的内存分区指针，该链表的长度可以动态定义。也就是说分区的数量可以动态定义。链表中的分区需要进行排序，排序的标准是每个分区中内存块的大小，内存块小的分区排在前面，内存块大的排在后面。因为分区采用首次适配的算法，排序以后可以减少内存浪费。
同时，系统提供了mem_alloc/mem_free两个函数来支持系统分区的申请和释放。申请的算法很简单，采用首次适配方法从分区链表中找到合适内存分区，如果该区空闲内存链表不为空，则返回该链表个内存块地址，否则查看下一个分区。如果找不到合适的内存块，则返回空指针。
释放算法稍微复杂一些，它需要先检查该内存块属于哪个分区。这样做非常必要，如果把一个小块放到大块的内存分区中，一个任务申请了该空间，则该空间的一部分将跨越到另一个内存块，对该内存块的操作可能覆盖另一个内存块的数据。如果把一个大块放到了小块的分区中，则在分配的时候将分配了多余的空间，造成了内存空间的浪费。找到所 图2创建内存分区流程图属分区后，直接把该块放到该区空闲内存链表的尾部。
上述系统分区的方式其实是小范围动态分区上实现的静态方式。因为每个内存块大小是固定的，这样不可避免地要浪费一部分空间。对于这个问题的解决，系统还提供了一种纯动态的解决办法，就是调用malloc/free函数来申请内存块。从内存划分图中可以看到有一块用户内存区，这是一块内核不会使用的内存区。该区留给用户使用，对于这块区域的申请和释放不调用系统提供的mem_alloc/mem_free函数，而是直接调用c语言提供的malloc/free函数。malloc具有不确定性，因为它的执行时间和空闲内存块的数量有关，而且多次使用malloc/free调用和释放内存块，可能产生大量的内存碎片。所以这种方式的调用要谨慎。由于用户内存区大小是可配置的，所以用户可以控制该区大小以减少碎片产生的问题。同时对于系统调用，例如任务堆栈分配，不会因为碎片太多而导致分配失败的问题。在嵌入式市场上，随着消费者要求新产品定期增加功能或提高应用灵活性，开发人员对修改系统应用功能的快捷性和简便性要求越来越高。从存储器角度看，这预示着可能需要用性能更高、合格检测更快的产品更换现有产品。新一代非易失性存储器应具备各种参数微调功能，能够缩减应用电路板的工程周期。不同应用在不同的容性负载下需要不同的工作频率，这项要求与芯片组的性能以及电路板布局和复杂性紧密相关。例如，高频工作环境通常对电性能的优化要求严格，设计工程师需要考虑整个电路板上的电噪声，以降低线路的寄生电容。在这种情况下，降低存储器输出驱动器的强度更加受欢迎。此外，还必须根据工作频率优化指令执行速度。有时候，要想在发送命令后取得适合的高效的吞吐量，就必须减少空时钟周期次数。
在应用电路板测试阶段，为了正确地激励存储器、查看存储器的响应，微控制器需要全套的命令和功能。这项操作灵活性测试通常用于检测全部系统组件，以确保产品在生命周期内的功能。相反，标准的客户终应用只使用一个精简的指令集。例如，在使用spi闪存时，终应用通常使用读指令(正常、快速和/或4位i/o输入输出)，把启动代码下载到ram存储器。
设计人员应该优化存储器，以缩减系统上电期间的代码读取和下载时间。在新的的平台上，如车用电子、计算机光驱或蓝牙模块，spi闪存可能用于直接从非易失性存储器读取部分系统固件，以缩短系统固件下载到高速易失性存储器的过程。当然，目前出现的新应用对存储器的灵活性要求更加严格，本文稍后再做详解。
spi闪存的的优点是引脚数量少而且固定不变(8个或16个)。串口闪存的这个特性可简化电路板布局，无需更改硬件即可升级固件，从而可以降低系统开发的总体成本。
由于在简易性和成本方面的强大优势，pc机和消费电子市场出现了并口闪存改用spi闪存的发展趋势。只要达到性能要求时，设备厂商就会优先选用串口闪存。计算机光驱、汽车电子、蓝牙模块、机顶盒和调制解调器市场正在引入这种能够把代码直接读到非易失性存储器内的spi闪存。
xip(片内执行)应用要求串口存储器提供一种“随机访存”仿真功能，即无需发送指令即可访问存储器内容，并准许以大的吞吐量访问存储器。因为传统用途是存储和下载代码，所以spi存储器是同步器件，xip功能迫使设计人员研发灵活的存储器，能够根据芯片组特性灵活地配置串行闪存。例如，在系统上电后，具有xip功能的器件需要基于命令、地址和数据的jedec协议，所以有些逻辑器件不准像管理xip器件一样管理串口闪存。
此外，有些逻辑器件只在一条线上或者多在两条线上支持xip模式，因为固有的硬件限制，不可能开启4位i/o输入输出模式。
后，因为实现一个混合协议、接受命令的传统存储器和不接受命令的非传统存储器的设计困难，芯片组厂商更愿意保留原有的spi指令结构，即命令、地址和数据。在这些情况下，高速协议结合并行化命令、地址和数据的方案更受市场欢迎。
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